Reserva Plaza
Entrenamiento Intensivo 2006 sobre:
FPGAs Xilinx - VHDL - Entorno de Diseño ISE
EDK: Microblaze y PowerPC
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Reserva de Plaza:
Entrenamiento VHDL-Xilinx-ISE
Semana 0,1,2
Semana 1,2
Semana 0,1
Semana 2
No VHDL-Xilinx-ISE
Entrenamiento
EDK-Microblaze/PowerPC
Completo
Básico (lunes-miércoles)
Avanzado (miércoles - viernes)
No EDK
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